ID de l'article: 000076079 Type de contenu: Dépannage Dernière révision: 14/11/2014

Pourquoi mon ALTLVDS_TX Intel® FPGA IP avec PLL externe ne fonctionne-t-elle pas correctement dans les périphériques Arria® V, Cyclone® V et Stratix® V lors de l’utilisation du logiciel Quartus® II version 14.0 ?

Environnement

  • Édition d'abonnement Intel® Quartus® II
  • PLL
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Il existe un problème connu lors de l’utilisation du contrôleur PLL Reconfig Intel® FPGA IP avec le Intel® FPGA IP ALTLVDS en mode PLL externe, dans la version 14.0 du logiciel Quartus® II lors de l’utilisation de périphériques Arria® V, Cyclone® V et Stratix® V.

    Après avoir compilé et adapté la conception, vous trouverez peut-être que le cycle d’utilisation du compteur C1 signalé dans l’Analyseur de synchronisation ne correspond pas au calcul décrit dans la solution connexe pour un taux de données défini par l’utilisateur.

    Résolution

    Pour contourner cette situation, le contrôleur de reconfiguration PLL doit être déconnecté de l’IP PLL externe qui pousse le Intel FPGA IP ALTLVDS.

    Ce problème devrait être résolu dans une version ultérieure du logiciel Intel® Quartus®.

     

     

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