Non, les implémentations à largeur mixte ne sont pas prises en charge pour les MLA.
Page 4-6 de la page 4 Manuel du périphérique Stratix® III indique incorrectement que les MLA peuvent prend en charge des largeurs de données mixtes grâce à l’émulation via le logiciel Quartus II. Également à la page 4-10, il indique de manière incorrecte que le logiciel Quartus® II peut implémenter des mémoires à largeur mixte dans les MLABs en utilisant plusieurs MLAB.
Si vous génèrez un FIFO à largeur mixte dans les MLA, le message d’erreur suivant est généré :
Error: Cannot use Write port width with Read port width in DCFIFO megafunction. The width ratio should be a power of 2.
Error: Assertion error: Valid clear box generator not found or Errors encountered during clear box generation
Error: Can't elaborate user hierarchy
This problem is scheduled to be fixed in a future version of the documentation.