Oui.Veuillez supprimer les contraintes suivantes sur les chemins PCS-PCD Rx dans le fichier SDC généré par le cœur IP CPRI :
set_multicycle_path -de [get_clocks {*receive_pcs0|recoveredclk rxclk_div4 rxclk_div2}] à [get_clocks rxclk] -setup -end 2
set_multicycle_path -de [get_clocks {*receive_pcs0|recoveredclk rxclk_div4 rxclk_div2}] -à [get_clocks rxclk] -hold -end 2
Ajoutez ensuite la contrainte suivante dans le fichier SDC généré par le cœur IP CPRI :
Si {$::quartus (nomeofexechargeable) == « quartus_fit » } {
set_min_delay (de {*wire_receive_pcs0_dataoutfull*} à {*|buf_wr_data*} 1,500
}
Dans le cœur IP v10.1 du CPRI, nous avons éliminé toutes les contraintes multi-cycle du fichier SDC et résolu le code RTL avec le fichier SDC mis à jour.