ID de l'article: 000083674 Type de contenu: Dépannage Dernière révision: 28/07/2015

SPI Esclave à Avalon perte de données de Master Bridge

Environnement

  • Édition d'abonnement Intel® Quartus® II
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans le logiciel Quartus® II, l’esclave SPI à Avalon® l’IP du pont maître peut faire tomber les données sous forte charge.

    Résolution

    Pour contourner ce problème, remplacez le fichier de synthèse/submodules/spiphypire.v généré par ce fichier : spiphyphise.v

    Produits associés

    Cet article concerne 37 produits

    FPGA Stratix® V GT
    FPGA Intel® Arria® 10 GX
    FPGA Arria® II GZ
    FPGA Stratix® II GT
    FPGA Cyclone® V E
    FPGA Stratix® V E
    FPGA Arria® V GT
    FPGA Cyclone® II
    FPGA Stratix® II
    FPGA Cyclone® V GX
    FPGA Arria® V GZ
    FPGA Stratix® V GS
    FPGA Stratix® II GX
    FPGA Arria® V GX
    FPGA Cyclone® V GT
    FPGA Cyclone® III
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    FPGA SoC Intel® Arria® 10 GX
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    FPGA Stratix®
    FPGA Stratix® GX
    FPGA Arria® GX
    FPGA SoC Cyclone® V SX
    FPGA SoC Cyclone® V ST
    FPGA SoC Cyclone® V SE
    FPGA Intel® Arria® 10 GT
    FPGA Intel® Stratix® 10 GX
    FPGA SoC Intel® Stratix® 10 GX
    FPGA Cyclone® IV E
    FPGA SoC Arria® V SX
    FPGA SoC Arria® V ST
    FPGA Cyclone®
    FPGA Cyclone® III LS
    FPGA Stratix® IV E
    FPGA GX Cyclone® IV

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