Oui, en raison d’un problème dans les versions 17.1 et antérieures du logiciel Intel® Quartus® Prime Pro Edition, il est possible que l’E/S 3V dans Intel® Stratix® 10 FPGAs pousse à un fort niveau élevé pendant la configuration lorsque les broches sont affectées en tant que sorties dans votre conception compilée.
Ce comportement n’est pas visible lorsque les E/S 3V sont affectées en tant qu’entrées ou E/S bidirectionnelles.
Ces E/S 3V se trouvent dans des banques d’E/S de 6A, 6B, 6C,7A, 7B,7C et sont disponibles en différentes variantes de densité et de package de périphériques Intel Stratix 10.
Ce problème devrait être résolu dans une prochaine version du logiciel Intel Quartus Prime Pro Edition.