Problème critique
En raison d’un problème avec la version 19.3 du logiciel Intel® Quartus® Prime Pro, l’exemple de conception générée par MAC 10G à faible latence Intel® FPGA IP peut rencontrer le problème ci-dessus. Cela s’explique par le fait que le modèle de simulation produit un « X » (non défini) au lieu de données valides. Cela entraîne la dés affirmation du signal de verrouillage du bloc et la simulation s’arrête ensuite.
Ce problème a été résolu à partir de la version 19.4 du logiciel Intel® Quartus® Prime Pro Edition.