ID de l'article: 000075583 Type de contenu: Dépannage Dernière révision: 05/05/2021

Pourquoi l’IP HDMI Intel® FPGA Source rencontre-t-elle une défaillance intermittente de la formation de la liaison HDMI 2.1 Tx après un fonctionnement de débranchement ou de réinitialisation ?

Environnement

  • Intel® Quartus® Prime Pro Edition
  • FPGA Intel® IP HDMI*
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    Problème critique

    Descriptif

    En raison d’un problème commençant par la version 19.4 du logiciel Intel® Quartus® Prime Pro lors de l’utilisation du Intel® Arria® 10 Appareils et de la version 20.4 du logiciel Intel® Quartus® Prime Pro lors de l’utilisation des périphériques Intel® Stratix® 10, le cœur IP HDMI Intel® FPGA Source peut rencontrer de manière intermittente une panne de formation de la liaison HDMI 2.1 Tx après un fonctionnement sous tension ou une réinitialisation.

    Ce problème est dû au fait que le cœur IP hdMI Intel® FPGA source ne surveille pas et n’efface pas l’indicateur d’état FLT_update d’apprentissage HDMI 2.1 de la destination du récepteur du dissipateur HDMI.

    Résolution

    Ce problème est résolu à partir de la Intel® Quartus® logiciel Prime Pro Edition version 21.1.

    Produits associés

    Cet article concerne 2 produits

    FPGA et FPGA SoC Intel® Arria® 10
    FPGA et FPGA SoC Intel® Stratix® 10

    Vous avez besoin d'aide ?

    Contacter l'assistance

    Avertissement

    1

    Toutes les publications et l'utilisation du contenu de ce site sont soumis aux Conditions d'utilisation d'Intel.fr.

    Le contenu de cette page est une combinaison de traduction humaine et informatique du contenu original en anglais. Ce contenu vous est fourni pour votre commodité et à titre informatif seulement et ne saurait être totalement exact ou complet. En cas de contradiction entre la version anglaise de cette page et la traduction, c'est la version anglaise qui prévaut. Afficher la version anglaise de cette page.