ID de l'article: 000074947 Type de contenu: Dépannage Dernière révision: 21/02/2014

Est-il possible d’activer ou de désactiver dynamiquement les réseaux d’horloge globale (GCLK) ou d’horloge régionale (RCLK) qui pilotent des fPLL dans Stratix® V, Arria® V ou Cyclone® V ?

Environnement

  • Édition d'abonnement Intel® Quartus® II
  • PLL
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Non, il n’est pas possible d’activer ou de désactiver dynamiquement les réseaux d’horloge globale (GCLK) ou d’horloge régionale (RCLK) qui pilotent des fPLL dans Stratix® V, Arria® V ou Cyclone® V.

    Cependant, en raison d’un problème dans la version 13.1 du logiciel Quartus® II et les versions précédentes, si vous utilisez le signal d’activation sur un bloc de contrôle d’horloge qui pousse un fPLL, la compilation ne tombera pas en panne.

     

    Résolution

    Les versions futures du logiciel Quartus II doivent générer un message d’erreur/d’avertissement lorsque vous utilisez le signal d’activation sur un bloc de contrôle d’horloge qui pilote un fPLL,

    Produits associés

    Cet article concerne 15 produits

    FPGA Stratix® V GT
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    FPGA SoC Cyclone® V ST
    FPGA SoC Arria® V ST
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    FPGA Cyclone® V GT
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