Centre d’assistance IP de l’émetteur-récepteur PHY

Le centre d’assistance IP de l’émetteur-récepteur PHY fournit des informations sur la façon de sélectionner, concevoir et mettre en œuvre les liens IP de l’émetteur-récepteur PHY.

Le centre d’assistance IP de l’émetteur-récepteur PHY fournit des informations sur la sélection, la conception et la mise en œuvre des liaisons d’émetteur-récepteur pour les appareils Agilex™ 7, Agilex™ 5, Stratix® 10, Arria® 10 et Cyclone® 10. Il existe également des directives sur la façon de faire apparaître votre système et de déboguer les liens de l’émetteur-récepteur. Cette page est organisée en catégories qui s’alignent sur un flux de conception de système d’émetteur-récepteur à grande vitesse du début à la fin.

Bénéficiez d’une assistance supplémentaire pour la conception de protocoles d’interface FPGA Agilex™ 7, la conception de protocoles d’interface FPGA Agilex™ 5, des parcours guidés étape par étape pour les flux de développement standard faisant apparaître les ressources et la documentation critiques clés.

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1. Sélection de l’appareil et de l’IP

Quelle famille d’appareils FPGA utiliser ?

Tableau 1 : variantes de périphériques et prise en charge des fonctionnalités
Appareil Agilex™ 7 Agilex™ 5 Stratix® 10 Arria® 10 Cyclone® 10
Variante de l’appareil AGF E-Tile GX/SX L-Tile GX/SX H-Tile MX/TX E-Tile SX(3) GX(3) GT(4) GX
Taux de données maximal
(puce à puce)(1)(7)		 Canaux GX - - 17,4 Gbit/s - 17,4 Gbit/s 17,4 Gbit/s 17,4 Gbit/s 12,5 Gbit/s
Canaux GXT - 26,6 Gbit/s 28,3 Gbit/s 28,3 Gbit/s - - 25,8 Gbit/s -
Canaux GXE 28,9 Gbit/s (NRZ)
57,8 Gbit/s (PAM4)		 - - 28,9 Gbit/s (NRZ)
57,8 Gbit/s (PAM4)		 - - - -
Taux de données maximal
(Fond de panier)(8)		 Canaux GX - 12,5 Gbit/s 28,3 Gbit/s 28,3 Gbit/s 12,5 Gbit/s 12,5 Gbit/s 12,5 Gbit/s 6,6 Gbit/s
Canaux GXT - 12,5 Gbit/s 28,3 Gbit/s 28,3 Gbit/s - 12,5 Gbit/s 12,5 Gbit/s -
Canaux GXE 28,9 Gbit/s (NRZ)
57,8 Gbit/s (PAM4)		 - - 28,9 Gbit/s (NRZ)
57,8 Gbit/s (PAM4)		 - - - -
Nombre maximal de canaux par appareil Canaux GX - 96 96 - 96 72 72 12
Canaux GXT - 32 64 24 - 6 6 -
Canaux GXE 24 (et 32 P-Tile) - - 120 - - - -
IP dur Un PCIe Gen2 x4 par appareil. Ethernet 10G/25G/100G avec capacité 1588 en option + RS-FEC (528, 514)/RS-FEC (544, 514) PCIe Gen3 x16 jusqu’à 4 par appareil MAC Ethernet 50/100 Gbit/s jusqu’à 4 par appareil PCIe Gen3 x16 jusqu’à 4 par appareil SR-IOV (quatre PF/2K VF) (6) Ethernet 10G/25G/100G avec capacité 1588 en option + RS-FEC (528, 514)/RS-FEC (544, 514) PCIe Gen3 x16 jusqu’à 4 par appareil PCIe Gen3 x16 jusqu’à 4 par appareil PCIe Gen3 x16 jusqu’à 4 par appareil Jusqu’à 4 PCIe* Gen3 x8 par appareil
L’assistance SR-IOV n’est pas disponible.
Notes:
  1. Les valeurs indiquées dans le tableau ci-dessus concernent les modes d’alimentation standard. En mode consommation réduite, le débit de données maximal pour Arria® 10 canaux d’appareil GX (puce à puce) est de 11,3 Gbit/s. Comme les canaux d’émetteur-récepteur GT sont conçus pour des performances de pointe, ils n’ont pas un mode de fonctionnement à consommation réduite. Pour faire fonctionner les canaux de l’émetteur-récepteur GX à des débits de données désignés en modes standard et à consommation réduite, appliquez les alimentations cœur et périphérie correspondantes. Pour plus de détails, reportez-vous à la fiche technique de l’appareil Arria® 10.
  2. Arria® émetteurs-récepteurs de périphériques 10 et Stratix® 10 peuvent prendre en charge des débits de données inférieurs à 1,0 Gbit/s grâce à un échantillonnage excessif.
  3. Pour les variantes de périphériques SX et GX, les débits de données maximum de l’émetteur-récepteur sont spécifiés pour le niveau de vitesse de l’émetteur-récepteur le plus rapide (–1). Reportez-vous à la fiche technique de l’appareil pour obtenir les spécifications de niveau de vitesse inférieure.
  4. Pour les variantes de dispositifs GT, les débits de données maximaux de l’émetteur-récepteur sont spécifiés pour le niveau de vitesse de l’émetteur-récepteur (-1). Reportez-vous à la fiche technique de l’appareil pour connaître les spécifications du niveau de vitesse inférieur.
  5. Stratix® 10 émetteurs-récepteurs de périphériques ont des canaux d’émetteur-récepteur de types GX et GXT. Pour plus de détails, reportez-vous au guide de l’utilisateur de l’émetteur-récepteur Stratix® 10 L-/H-Tile PHY.
  6. SR-IOV est l’abréviation de Single-Root Input Output Virtualization.
  7. Arria® émetteurs-récepteurs de périphériques 10 et Stratix® 10 peuvent prendre en charge des débits de données inférieurs à 1,0 Gbit/s grâce à un échantillonnage excessif.
  8. Les applications de fond de panier font référence à celles qui nécessitent une égalisation avancée, comme l’égalisation à retour de décision (DFE) activée pour compenser la perte de canal.
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Fiches techniques de l’appareil FPGA

Ressources additionnelles

Reportez-vous au chapitre Vue d’ensemble des guides de l’utilisateur suivants :

Thème Agilex™ 7 Stratix® 10 Arria® 10 Cyclone® 10
Ressources additionnelles
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2. Flux de conception et intégration IP

Où puis-je trouver des informations sur l’utilisation des émetteurs-récepteurs ?

Utilisez l’outil de placement des canaux E-Tile conjointement avec les directives de connexion des broches de la famille d’appareils Stratix® 10 pour planifier rapidement le placement des protocoles dans l’E-Tile avant de lire une documentation complète et de mettre en œuvre des conceptions dans le logiciel Quartus® Prime. L’outil de placement des canaux E-Tile basé sur Excel est complété par des onglets d’instructions, de légendes, de révision et de protocoles.

Thème : Agilex™ 7 Agilex™ 5 Stratix® 10 Arria® 10 Cyclone® 10
Quelles recommandations de conception dois-je prendre en compte ?
Où puis-je trouver des informations sur l’intégration IP de l’émetteur-récepteur PHY ?
Où puis-je trouver des informations sur le mappage du registre IP de l’émetteur-récepteur PHY ?
Directives de réglage analogique
Ressources additionnelles
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3. Conception de la carte et gestion de l’alimentation

Thème : Agilex™ 7 Agilex™ 5 Stratix® 10 Arria® 10 Cyclone® 10 Max® 10 Stratix® V Arria® V Cyclone® V Max® V

Guides de conception des cartes mères
Directives de connexion des broches
Examen des schémas
Gestion de la consommation
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Modèles et outils de simulation

Analyseur de lien avancé

L’Advanced Link Analyzer est un outil d’analyse de pointe de la liaison jitter/bruit qui vous permet d’évaluer rapidement et facilement les performances des liaisons série à haut débit. Il s’agit d’un outil de préconception idéal pour vous aider à comprendre comment FPGA solutions peuvent répondre aux exigences de votre système. Il s’agit également d’un outil efficace pour l’assistance post-conception afin de faciliter le débogage et la validation.

Modèle

Guides de l’utilisateur du kit de développement

Thème Agilex™ 7 Stratix® 10 Arria® 10
Guides de l’utilisateur du kit de développement
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4. Interopérabilité et tests de normes

Thème : Agilex™ 7 Agilex™ 5 Stratix® 10 Arria® 10 Cyclone® 10 Max® 10
Applications
Modèle
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5. Exemples de conception et conceptions de référence

Thème Agilex™ 7 Stratix® 10 Arria® 10 Cyclone® 10
Exemples de conception et conceptions de référence
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6. Cours de formation et vidéos

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Autres formations

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7. Débogage

Outils

Outil de débogage de l’émetteur-récepteur Stratix® 10 E-Tile Device

L’outil de débogage se compose de deux sous-outils

  1. L’outil Status vous permet de lire et de réinitialiser les paramètres PMA et de les enregistrer dans un fichier. Il vous permet également d’effectuer un flux d’adaptation (bouclage interne/externe, adaptation initiale), de lire et de réinitialiser des erreurs de bit.
  2. L’outil de réglage vous permet de régler l’émetteur-récepteur avec les configurations de paramètres PMA de base pour 10 Gbit/s / 28 Gbit/s / 56 Gbit/s et avec des paramètres personnalisés, il vous permet de balayer les paramètres PMA et de les enregistrer dans un fichier. Utilisez cet outil pour analyser l’état des canaux d’émetteur-récepteur dans votre E-Tile de périphérique Stratix® 10.

Télécharger l’outil de débogage de l’émetteur-récepteur E-Tile pour Stratix® 10

Outil de débogage PHY de l’émetteur-récepteur Stratix® 10 tuile L/tuile H

Cet outil de débogage se compose de quatre sous-outils :

  1. L’outil de tension vous permet de mesurer la tension au niveau du nœud d’échantillonnage des données du récepteur et du nœud émetteur
  2. L’outil Channel Status vous permet de vérifier l’état verrouillé pour les données de récupération des données d’horloge du récepteur (CDR), l’état d’étalonnage, l’état de bouclage et l’état du générateur/vérificateur PRBS
  3. L’outil d’état de l’adaptation vous permet de vérifier de manière croisée les bits d’adaptation enregistrés configurés par rapport aux paramètres du bit doré -Les bits dorés sont les paramètres de bits recommandés pour un registre donné
  4. L’outil de débogage des yeux vous permet de mesurer la hauteur et/ou la largeur de l’œil

Utilisez cet outil pour analyser la santé des canaux d’émetteur-récepteur dans votre périphérique Stratix® 10 L-Tile/H-Tile

Téléchargez l’outil de débogage de l’émetteur-récepteur L-Tile/H-Tile PHY pour Stratix® 10

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Cet analyseur d’arbre d’erreurs interactif fournit des directives pour le dépannage des problèmes que vous pouvez rencontrer lors de l’utilisation de l’émetteur-récepteur Arria® 10 périphériques PHY. L’analyseur se compose de trois sections :

  1. Débogage PHY natif
  2. Débogage du réglage des liens
  3. Débogage de reconfiguration dynamique

Utilisez cet analyseur d’arbre de défauts pour vous aider à résoudre les problèmes d’émetteur-récepteur PHY et à améliorer votre conception aussi efficacement que possible. Utilisez-le avec l’outil de débogage PHY de l’émetteur-récepteur Arria® 10 Device

Téléchargez l’analyseur d’arbre de défauts de l’émetteur-récepteur PHY pour le Arria® 10

Outil de débogage PHY de l’émetteur-récepteur Arria® 10

Cet outil de débogage se compose des quatre mêmes sous-outils que la version Stratix® 10 :

  1. L’outil de tension vous permet de mesurer la tension au niveau du nœud d’échantillonnage des données du récepteur et du nœud émetteur
  2. L’outil Channel Status vous permet de vérifier l’état verrouillé pour les données de récupération des données d’horloge du récepteur (CDR), l’état d’étalonnage, l’état de bouclage et l’état du générateur/vérificateur PRBS
  3. L’outil d’état de l’adaptation vous permet de vérifier de manière croisée les bits d’adaptation enregistrés configurés par rapport aux paramètres du bit doré -Les bits dorés sont les paramètres de bits recommandés pour un registre donné
  4. L’outil de débogage des yeux vous permet de mesurer la hauteur et/ou la largeur de l’œil

Utilisez cet outil pour analyser l’état des canaux d’émetteur-récepteur dans votre périphérique Arria® 10.

Téléchargez l’outil de débogage de l’émetteur-récepteur PHY pour l’appareil Arria® 10

Thème Agilex™ 7 Agilex™ 5

Quartus® Prime1

 Stratix® 10 Arria® 10 Cyclone® 10
Notes de mise à jour de Intellectual Property (IP) Core
Errata de périphérique FPGA
Guides de l’utilisateur (reportez-vous au chapitre sur les fonctions de débogage dans les guides de l’utilisateur suivants)
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1. Les notes de mise à jour de l’IP de l’émetteur-récepteur PHY natif se trouvent désormais dans les notes de mise à jour de la suite Quartus® Prime Design.

Guide de mappage des registres d’émetteur-récepteur

Thème : Agilex™ 7 Agilex™ 5 Quartus® Prime Stratix® 10 Arria® 10 Cyclone® 10
Guide de mappage des registres d’émetteur-récepteur
Ressources additionnelles
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Solution basée sur les connaissances

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