Partenaires EDA : FPGA systèmes EDA
Partenaires EDA
Notre écosystème EDA garantit que vous disposez d’une solution de conception complète dans la conception, la vérification et l’intégration des FPGAs Intel® dans vos systèmes.
Conception au niveau du système
Fournisseur EDA |
Nom du produit |
Solution de conception |
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Outil de conception de haut niveau |
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Inscrivez la gestion des cartes |
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Synthèse de haut niveau |
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Synthèse de haut niveau |
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Synthèse de haut niveau |
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Outil de conception de haut niveau |
Création de conception
Fournisseur EDA |
Nom du produit |
Solution de conception |
|---|---|---|
Outil de gestion de projet, de conception et d’analyse |
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Saisie de la conception, compréhension de code, gestion de projet et collaboration |
Synthèse
Fournisseur EDA |
Nom du produit |
Solution de conception |
|---|---|---|
Synthèse logique |
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Synthèse logique avancée |
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Outil de fermeture de temps |
Simulation
Fournisseur EDA |
Nom du produit |
Solution de conception |
|---|---|---|
Simulation |
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Simulation |
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mulation |
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Simulation |
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Simulation |
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Simulateur de Cloud métrique |
Simulation | |
Simulation |
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| Synopsys | Vcs | Simulation |
Vérification
Fournisseur EDA |
Nom du produit |
Solution de conception |
|---|---|---|
Vérification des règles de conception et vérification du croisement de domaines d’horloge (CDC) |
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| Bleu À l’écran bleu | Checker RTL |
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Générateur de contraintes |
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Croisement de domaines d’horloge (CDC) |
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Vérification officielle |
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Générateur de contraintes |
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Vérification de l’exception de synchronisation |
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Validation de l’exception de synchronisation |
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Vérification d’équivalence |
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Vérification fonctionnelle |
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Vérification du croisement de domaines d’horloge |
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Vérification du croisement de domaines d’horloge |
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Générateur de testbench |
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Vérification de la synchronisation |
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Analyse RTL des conceptions FPGA |
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Contrôles de peluches |
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Vérification du croisement de domaines d’horloge (CDC) |
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Vérification des propriétés fonctionnelles |
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Vérification d’équivalence logique |
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Vérification dans le système et débogage RTL intégré |
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Vérification dans le système |
Conception au niveau de la carte
Fournisseur EDA |
Nom du produit |
Solution de conception |
|---|---|---|
Schémas et disposition de la carte de circuits imprimés |
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FPGA la planification des E/S |
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Analyse des si |
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Création d’Allegro Design |
Schémas des cartes de circuits imprimés |
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Schémas des cartes de circuits imprimés |
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Topographie de la carte de circuits imprimés |
||
Topographie de la carte de circuits imprimés |
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| Keysight Technologies | Logiciel de conception PathWave | Système de conception avancée PathWave (ADS) |
FPGA la planification des E/S |
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Analyse des si |
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Schémas des cartes de circuits imprimés |
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Schémas et disposition de la carte de circuits imprimés |
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Topographie de la carte de circuits imprimés |
||
Topographie de la carte de circuits imprimés |
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Logiciel Signal Integrity, Inc. (SiSoft) |
Analyse des si |
Prototypage ASIC
Optimisation de la conception
| Solution de conception | de nom de produit | du fournisseur EDA |
|---|---|---|
| ntifier Ense | À l’avant- | Logiciel d’optimisation de la conception |
Tous les partenaires EDA
Partenaire du programme ACCESS |
Conception au niveau du système |
Création de conception |
Synthèse |
Simulation |
Vérification |
Conception au niveau de la carte |
Prototypage ASIC |
Optimisation de la conception |
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Logiciel Signal Integrity, Inc. (SiSoft) |
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