ID de l'article: 000097743 Type de contenu: Messages d'erreur Dernière révision: 10/06/2025

Pourquoi Signal Tap affiche-t-il « Programmer l’appareil pour continuer » lors de l’utilisation de l’IP JTAG-Over-Protocol pour appuyer sur la logique dans une partition PR (Partial Reconfiguration) ?

Environnement

    Intel® Quartus® Prime Pro Edition
    FPGA Intel® IP pour analyseur logique Signal Tap
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descriptif

En raison d’un problème dans la version 23.4 et antérieures du logiciel Quartus® Prime Pro Edition, l’IP de l’analyseur logique Signal Tap affiche « Programmer l’appareil pour continuer » lorsqu’il tente d’exploiter la logique dans une partition PR lors de l’utilisation de l’IP JTAG-Over-Protocol.

Résolution

Pour contourner ce problème, désactivez l’option Activer l’utilisation de TCK-ENA dans l’IP JTAG-Over-Protocol.

Ce problème devrait être résolu dans une future version du logiciel Quartus® Prime Pro Edition.

Produits associés

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FPGA et FPGA SoC Intel® Stratix® 10

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