ID de l'article: 000097129 Type de contenu: Dépannage Dernière révision: 30/10/2023

Pourquoi la fonction de gel CDR ne fonctionne-t-elle pas pour les Intel® FPGA IP F-Tile PMA/FEC Direct PHY ?

Environnement

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans le logiciel Intel® Quartus® Prime Pro Edition version 23.3 et antérieure, la fonction de gel CDR de l’application GPON ne fonctionne pas comme prévu lors de l’utilisation de F-Tile PMA/FEC Direct PHY Intel® FPGA IP.

    Résolution

    Pour que la fonction de gel du CDR fonctionne, vous devez :

    1. Configurez l’interface graphique du Intel® FPGA IP F-Tile PMA/FEC Direct PHY comme suit :

    • Définir les règles de configuration FGT PMA sur GPON
    • Définir le mode d’adaptation comme manuel
    • Activer le port fgt_rx_cdr_fast_freeze_sel
    • Activer le port fgt_rx_cdr_freeze

    2. Une fois le fichier SOF de conception programmé, activez la fonction de gel CDR en définissant les deux registres FGT suivants :

    • 0x62000[16] à 1'b1
    • 0x62004[12] à 1'b1

    Notez que les registres ci-dessus ne s’appliquent qu’aux canaux placés sur la voie 0. Pour les canaux placés sur d’autres voies, vous devez ajouter une adresse décalée. Pour plus de détails, reportez-vous au Guide de l’utilisateur de l’architecture F-Tile et du PMA et FEC Direct PHY.

    3. Pilotez les signaux comme suit :

    • Attachez le signal fgt_rx_cdr_fast_freeze_sel à 1'B0
    • Affirmez le signal fgt_rx_cdr_freeze à 1'b1 lorsque la rafale se termine, et dé-affirmez le signal fgt_rx_cdr_freeze à 1'b0 lorsque la rafale commence

    Ce problème devrait être résolu dans une prochaine version du logiciel Intel® Quartus® Prime Pro Edition.

    Produits associés

    Cet article concerne 1 produits

    FPGA et FPGA SoC Intel® Agilex™ 7

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