ID de l'article: 000092736 Type de contenu: Dépannage Dernière révision: 15/08/2023

Pourquoi l’état du signal rx_ready n’est-il pas élevé lorsque la reconfiguration dynamique des vitesses élevées (>6G) aux vitesses basses (<=6G) est effectuée dans l’exemple de conception multidébit CPRI ?

Environnement

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans la version 22.3 du logiciel Intel® Quartus® Prime Pro Edition, le signal d’état rx_ready ne sera pas élevé dans l’exemple de conception multidébit CPRI lors de la reconfiguration dynamique de vitesses élevées (>6 G) à des vitesses basses (< = 6 G).

    Résolution

    Pour contourner ce problème dans le logiciel Intel® Quartus® Prime Pro Edition version 22.3 lorsque vous reconfigurez dynamiquement le débit CPRI de la variante haute vitesse (>6G) à la variante basse vitesse (<=6G), procédez comme suit.

    1. Téléchargez le script de contournement « ftile-cpri-dr-test.tcl »
    2. Accédez à <your_example_design_directory>/hardware_test_design/hwtest/
    3. Remplacez le fichier « ftile_cpri_dr_test.tcl » par le fichier téléchargé.

    Les principaux changements apportés au script de contournement sont les deux commandes d’accès aux attributs FGT affirmées à des débits CPRI de 6 Gbit/s et inférieurs :

    • CPI_assert_req 0 $RESET_LANE($lane_numéro)
    • CPI_assert_req 0 $SET_MODE_BYPASS($lane_number)

    Ce problème est résolu à partir de la version 22.4 du logiciel Intel® Quartus® Prime Pro Edition.

    Produits associés

    Cet article concerne 2 produits

    FPGA et FPGA SoC Intel® Agilex™ série F
    FPGA et FPGA SoC Intel® Agilex™ série I

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