ID de l'article: 000092438 Type de contenu: Messages d'erreur Dernière révision: 07/10/2022

Erreur (272006) : MGL_INTERNAL_ERROR : port <altera_syncram_instance_hierarchy> altera_syncram_impl1|d ecc_addr_reg|dl inst inst a déjà été affectée</altera_syncram_instance_hierarchy>

Environnement

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans la version 22.2 du logiciel Intel® Quartus® Prime Pro Edition et versions antérieures, il est possible que vous voyiez ce message d’erreur pendant la compilation à l’étape de synthèse de la RAM simple à deux ports lorsque vous utilisez les configurations suivantes :

    · Paramètre device_family = « Agilex »

    · Paramètre ram_block_type = « M20K »

    · Paramètre enable_ecc = « TRUE »

    · Address_aclr_b de paramètre = « ACLEAR »

    · Paramètre outdata_reg_b = « CLOCK0/CLOCK1 »

    · La largeur x num width est plus de 20480 bits (plus de 1 M20K utilisé)

    · Aucun signal d’activation de la lecture n’est utilisé

     

     

    Résolution

    Un correctif est disponible pour résoudre ce problème pour la Intel® Quartus® version 21.4 et 22.2 du logiciel Prime Pro Edition.

    Téléchargez et installez les correctifs à partir des liens suivants :

    Pour Intel® Quartus® version 21.4 du logiciel Prime Pro Edition :

    Pour Intel® Quartus® logiciel Prime Pro Edition version 22.2 :

    Ce problème est résolu à partir de la version 22.3 du logiciel Intel® Quartus® Prime Pro Edition.

    Produits associés

    Cet article concerne 1 produits

    FPGA et FPGA SoC Intel® Agilex™

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