ID de l'article: 000091610 Type de contenu: Errata Dernière révision: 15/06/2023

Pourquoi ma valeur calculée pour l’interface utilisateur Tx ou Rx est-elle incorrecte lors de l’utilisation des scripts trouvés dans les exemples de conception des variantes PTP (Precision Time Protocol) du Intel® FPGA Hard IP Ethernet F-Ti...

Environnement

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans la version 22.2 du logiciel Intel® Quartus® Prime Pro Edition, les scripts fournis dans les conceptions Intel® FPGA Hard IP Ethernet F-Tile avec protocole PTP (Precision Time Protocol) peuvent afficher des valeurs d’interface utilisateur Tx ou Rx incorrectes.

    Résolution

    Pour contourner ce problème, suivez les étapes suivantes :

    1. Ouvrez le script de microprogramme PTP situé dans < dossier de conception d’exemples généreux>/hardware_test_design/hwtest/altera/ptp/ptp_fw.tcl
    2. Trouvez et remplacez les lignes de code suivantes :
    • FROM set tx_tam_cnt [format 0x%X [expr [expr $rd_data & 0x3FFF0000] >> 16]].
    • POUR définir tx_tam_cnt [format 0x%X [expr [expr $rd_data & 0x7FFF0000] >> 16]].
    • FROM set rx_tam_cnt [format 0x%X [expr [expr $rd_data & 0x3FFF0000] >> 16]].
    • POUR définir rx_tam_cnt [format 0x%X [expr [expr $rd_data & 0x7FFF0000] >> 16]
    • DEPUIS le tx_tam_cnt_delta_max 32767
    • POUR définir tx_tam_cnt_delta_max 32768
    • DEPUIS le rx_tam_cnt_delta_max 32767
    • POUR définir rx_tam_cnt_delta_max 32768
    1. Enregistrez le fichier

    Ce problème a été résolu à partir de la version 22.3 du logiciel Intel® Quartus® Prime Pro Edition.

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    FPGA et FPGA SoC Intel® Agilex™

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