ID de l'article: 000086266 Type de contenu: Dépannage Dernière révision: 23/10/2020

Pourquoi ma conception de SoC Intel® Stratix® 10 ne détecte-t-elle pas parfois une transition sur hps_cold_nReset ?

Environnement

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans la fiche technique du périphérique 10 Intel® Stratix®, l’exigence de largeur d’impulsion sur la broche HPS_cold_nReset SDM FPGA Intel Stratix 10 HPS_cold_nReset n’est pas documentée.

    Résolution

    La largeur d’impulsion requise sur la broche hps_cold_nReset est de 3 ms.

    Note:

    • Il n’est pas nécessaire de réinitialiser à froid le HPS si l’intention est de reconfigurer le périphérique à l’aide du signal nConfig .  Un événement nConfig (reconfiguration) effacera l’ensemble du périphérique (HPS et FPGA), puis reconfigurera le périphérique à partir du périphérique d’amorçage sélectionné (paramètre MSEL).
    •  nConfig ne doit pas être publié lorsqu’une réinitialisation HPS est en cours. S’il y a une réinitialisation HPS en cours, attendez que la réinitialisation HPS se termine avant d’émettre nConfig : plus de 10 ms à partir du moment où la réinitialisation HPS est activée.

    Également voir : Pourquoi mon périphérique SoC Intel Stratix 10 ne démarre-t-il pas ou ne se configure-t-il pas correctement, si je réinitialise le HPS pendant un événement de configuration ?

    Ce problème est résolu à partir de la version 20.3 du logiciel Intel® Quartus® Prime Pro Edition.

    Produits associés

    Cet article concerne 3 produits

    FPGA SoC Intel® Stratix® 10 GX
    FPGA Intel® Stratix® 10 MX
    FPGA Intel® Stratix® 10 TX

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