ID de l'article: 000086104 Type de contenu: Dépannage Dernière révision: 14/03/2016

Pourquoi vois-je une erreur d’accès à mon IP FPGA sur mon Intel® Arria® 10 SoC Design ?

Environnement

  • Intel® Quartus® Prime Pro Edition
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Dans le chargeur de démarrage U-Boot 10 Arria® de la version 15.1.2 du SoC EDS et des versions antérieures, il existe un délai d’expiration du NOC qui reste incorrectement activé par la fonction reset_assert_all_bridges. Ce délai peut être atteint si l’IP de l’FPGA est lente à répondre, ce qui entraîne une erreur d’accès.

     

     

    Résolution

    Ce problème devrait être résolu dans la prochaine version de SOC EDS. Un correctif est disponible pour résoudre ce problème avec les versions précédentes ici : https://github.com/altera-opensource/u-boot-socfpga

    Produits associés

    Cet article concerne 2 produits

    FPGA SoC Intel® Arria® 10 GX
    Intel® Arria®

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