ID de l'article: 000086010 Type de contenu: Dépannage Dernière révision: 23/03/2020

Pourquoi mon exemple de conception Nios® II Simple Socket Server (RGMII) La liaison Ethernet est désactivée lors de l’exécution sur Intel FPGA Development Kits avec MARVELL PHY ?

Environnement

  • Intel® Quartus® Prime Pro Edition
  • Suite Embedded Design Intel® Nios® II (EDS)
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans Nios® II’outil de programmation de logiciels, les paramètres par défaut d’Nios® II modèle RMII (Simple Socket Server) ne sont pas destinés à MARVELL PHY, ce qui a entraîné une mauvaise configuration PHY entraînant l’interruption de la liaison Ethernet.

    Ce problème est observé dans Nios® II version 17.1 du SBT.

    Résolution

    Pour contourner ce problème, l’utilisateur doit modifier les paramètres ci-dessous dans le modèle pour activer les configurations MARVELL PHY RGMII.

    Naviguez jusqu’au répertoire du projet : .. /software/<project_name>/tse_my_system.c

    Étape 1. Supprimez les commentaires de la définition suivante :

    /* si vous utilisez Marvell phy et que vous voulez le mode rgmii, décommentez cette définition */

    #define SET_MARVELL_RGMII_MODE //décommenter cette définition pour activer RGMII

    #ifdef SET_MARVELL_RGMII_MODE

    #define ADDITIONAL_PHY_CFG et marvell_cfg_rgmii

    #else

    #define ADDITIONAL_PHY_CFG 0

    #endif

    Étape 2. Trouvez la définition « ifdef DESCRIPTOR MEMORY BASE  » et vérifiez lepremier argument de la fonction TSE_SYSTEM_EXT_MEM_NO_SHARED_FIFO à déclarer comme « ETH_TSE » et non comme « TSE_0_TSE »

    Comme indiqué dans la partie de code suivante :

    #ifdef DESCRIPTOR_MEMORY_BASE

    alt_tse_system_info tse_mac_device[MAXNETS] = {

    TSE_SYSTEM_EXT_MEM_NO_SHARED_FIFO(ETH_TSE, 0, TSE_0_DMA_TX, TSE_0_DMA_RX, TSE_PHY_AUTO_ADDRESS, ADDITIONAL_PHY_CFG, DESCRIPTOR_MEMORY)

    };

    Produits associés

    Cet article concerne 2 produits

    Intel® Cyclone®
    CPLD et FPGA Intel® MAX®

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