ID de l'article: 000085891 Type de contenu: Dépannage Dernière révision: 04/05/2015

Échecs de synchronisation erronées dans les interfaces QDR-IV sur Arria 10 périphériques

Environnement

    Édition d'abonnement Intel® Quartus® II
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Problème critique

Descriptif

Ce problème affecte les interfaces QDR-IV sur Arria 10 périphériques.

Les défaillances de synchronisation des E/S suivantes sont susceptibles d’être signalées :

  • Le timing DK par rapport à CK est susceptible de tomber en panne, car le modèle de synchronisation actuel suppose que l’étalonnage DK/CK n’est pas effectué, mais en réalité, l’étalonnage DK/CK est effectué.
  • Le timing d’écriture est susceptible de tomber en panne, car le timing actuel modèle est incorrect.

Les deux échecs de synchronisation décrits ci-dessus sont faux et peuvent être ignoré.

Résolution

Il n’y a pas de solution à ce problème.

Ce problème est résolu dans la version 15.0.

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FPGA et FPGA SoC Intel® Arria® 10

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