ID de l'article: 000085267 Type de contenu: Dépannage Dernière révision: 12/09/2012

Reconfg_clk port de module de reconfiguration peut-il être géré par ref_clk ?

Environnement

  • PCI Express*
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Si vous utilisez la Stratix V Hard IP avec CVP, reconfig_clk doit être la même que refclk pour CVP. Pour les non-CVP, il peut être dérivé d’une source d’horloge libre séparée.

    Résolution

     

    Produits associés

    Cet article concerne 1 produits

    FPGA Stratix® V GX

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    Avertissement

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