ID de l'article: 000085146 Type de contenu: Messages d'erreur Dernière révision: 21/08/2012

Erreur : {instance_name}: le module possède trop d’horloges nonassociées ({instance_name}.pll_ref_clk, {instance_name}.afi_half_clk_in). Une seule horloge nonassociée est autorisée

Environnement

  • Édition d'abonnement Intel® Quartus® II
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Lorsque vous connectez un contrôleur master Uniphy à un contrôleur uniphy esclave pour partager la PLL et la DLL dans le système généré par SOPC Builder, vous rencontrez le message d’erreur suivant :

    Erreur : {instance_name}: le module possède trop d’horloges nonassociées ({instance_name}.pll_ref_clk, {instance_name}.afi_half_clk_in). Une seule horloge nonassociée est autorisée

    Résolution

    Le partage Uniphy PLL n’a jamais été pris en charge dans SOPC Builder. Utilisez Qsys pour générer votre système.

     

    Jusqu’à la version 11.0 du logiciel Untill Quartus® II, vous pourriez générer un système et connecter manuellement les signaux pll_* et dll_* dans le RTL (car le gui ne les affiche pas pour vous connecter).

     

    À partir de la version 11.0SP1 du logiciel Quartus II, la connexion manuelle des signaux dans le RTL pour partager la PLL et la DLL ne fonctionnera plus.

     

    Vous devrez utiliser Qsys afin de générer un système qui partage la PLL et la DLL entre plusieurs contrôleurs.

    Produits associés

    Cet article concerne 8 produits

    FPGA Stratix® II GX
    FPGA Stratix® V GT
    FPGA Stratix® V GS
    FPGA Stratix® V GX
    FPGA Stratix® IV E
    FPGA Stratix® II GT
    FPGA Stratix® III
    FPGA Stratix® V E

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