ID de l'article: 000084996 Type de contenu: Dépannage Dernière révision: 01/10/2013

Directives de connexion des broches de la famille de broches Cyclone famille de périphériques IV : problèmes connus

Environnement

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descriptif

Problème 137246 : Version 1.5

Si les connexions JTAG ne sont pas utilisées, vous devez connecter le TCK à GND, TDI et les broches TMS à VLAC,et laisser TDO non connecté.

Problème 77849 : Version 1.4

Cyclone les périphériques IV E ne possèdent pas de broche d’horloge CLK0 dédiée. Jusqu’à 15 broches d’horloge dédiées (CLK[15.1]) sont fournies.

Problème 59732 : Version 1.4

DATA0 et DATA1 sont indiqués comme étant des « open-drain bidirectionnels », mais cela est incorrect et sera corrigé pour indiquer qu’ils ne sont que « bidirectionnels ».

Problème 382585, version 1.4

La remarque 2 ne répernumera pas toutes les tensions de VCC_CLKIN disponibles pour les banques de 3B et 8B.  La version 1.4 n’indique que 2,5 V, mais 1,2 V, 1,5 V, 1,8 V, 2,5 V, 3,0V et 3,3 V sont autant de tensions prises en charge par les VCC_CLKIN sur les banques de 3B et 8B.

Numéro 66844, Version 1.4

Pour la note de broche CRC_ERROR 24 sera supprimée car elle n’a aucun rapport avec la broche CRC_ERROR.

La description des broches sera également mise à jour pour refléter que la broche CRC_ERROR est toujours une broche à drain ouvert si elle est utilisée comme une broche CRC_ERROR et qu’elle n’est pas une sortie dédiée où vous pouvez activer la broche CRC_ERROR comme une broche ouverte dans l’onglet détection CRC_ERROR de la boîte de dialogue Options de périphérique et de broche.

Produits associés

Cet article concerne 2 produits

FPGA Cyclone® IV E
FPGA GX Cyclone® IV

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