Dans le tableau 2 d’AN141, deux configurations d’adresses SDRAM sont indiquées, 8x11 et 10x12. Dans chaque configuration, les bits de la ligne supérieure indiquent adresse de ligne, et les bits de la ligne inférieure indiquent l’adresse de la colonne.
Les bits d’adresse du contrôleur SDRAM des périphériques EPXA sont toujours mis en correspondance dans l’ordre suivant à partir du bit 2 :
- Adresse de colonne
- Adresse bancaire
- Adresse de ligne
Les bits d’adresse 1.0 sont utilisés pour décoder le masque de byte et activer les broches DQM[3.0]