ID de l'article: 000084324 Type de contenu: Dépannage Dernière révision: 28/08/2012

Pourquoi les horloges d’émetteur-récepteur de mon Cyclone conception PCI Express IV GX ne sont-elles pas générées automatiquement correctement lors de l’utilisation de la commande derive_pll_clocks dans la version 11.1 du logiciel Quartus II ?

Environnement

  • Édition d'abonnement Intel® Quartus® II
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans la version 11.1 du logiciel Quartus® II, la derive_pll_clocks commande peut ne pas générer toutes les horloges nécessaires aux conceptions PCI Express Cyclone® IV GX. Il est possible que vous voyiez des avertissements semblables à ceux qui suivent dans l’analyseur de synchronisation TimeQuest :

    Warning (332087): The master clock for this clock assignment could not be derived.
    Clock: |hiptxclkout was not created.
    Warning (332086): Ignoring clock spec: |cyclone_iii.cycloneiv_hssi_pcie_hip|pclkch0 Reason:
    Clock derived from ignored clock: |transmit_pcs0|hiptxclkout.  Clock assignment is being ignored.
    Warning (332086): Ignoring clock spec: |cyclone_iii.cycloneiv_hssi_pcie_hip|coreclkout Reason:
    Clock derived from ignored clock: |cyclone_iii.cycloneiv_hssi_pcie_hip|pclkch0.  Clock assignment is being ignored.

    En raison de ce problème, certaines horloges d’émetteur-récepteur peuvent ne pas être correctement limitées dans votre conception et l’IP peut ne pas fonctionner correctement dans le matériel.

    Résolution

    Un correctif est disponible pour résoudre ce problème pour la version 11.1 du logiciel Quartus II. Téléchargez et installez le correctif 0.09 à partir du lien approprié ci-dessous.

    Ce problème est résolu à partir du logiciel Quartus II version 11.1 SP1.

    Produits associés

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    FPGA GX Cyclone® IV

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