ID de l'article: 000084309 Type de contenu: Dépannage Dernière révision: 09/12/2013

Pourquoi vois-je une erreur fatale dans le logiciel Quartus II après avoir routage mon débit PLL Stratix III directement sur une broche de sortie du périphérique ?

Environnement

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descriptif

En raison d’un problème dans la version 13.1 du logiciel Quartus® II et les versions précédentes, vous pouvez constater une erreur fatale si vous connectez un débit d’horloge PLL Stratix® III directement à une broche de sortie du périphérique.

Résolution

Pour contourner cette erreur, ou bien :

  • Retirez la connexion.
  • Utilisez l’horloge de sortie PLL pour horloger une étape de registre de sortie DDIO qui a data_h port lié à \'1\' et il \'s port data_l lié à \'0\'. Cela permet de propager le signal d’horloge à travers l’étape de sortie du DDIO, mais supprime la connexion directe à la broche.

Ce problème devrait être résolu dans une prochaine version du logiciel Quartus II.

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FPGA Stratix® III

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