La reconfiguration du diviseur post-échelle du VCO n’est prise en charge que dans les versions logicielles 13.0 et ultérieures de Quartus® II via le PLL_RECONFIG Intel® FPGA IP.
Le décalage d’adresse du registre qui contrôle ce paramètre est 011100. L’écriture d’un « 0 » définit une valeur de division du coût de possession de 1. L’écriture d’un « 1 » définit une valeur de division du coût de possession de 2.