ID de l'article: 000084027 Type de contenu: Messages d'erreur Dernière révision: 06/08/2018

Avertissement (10240) : avertissement Verilog HDL Always Construct à altpciexpav_stif_txresp_cntrl.v

Environnement

  • Édition d'abonnement Intel® Quartus® II
  • Intel® Quartus® Prime Standard Edition
  • Hard IP pour PCI Express* Intel® Arria® 10 Cyclone® 10
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans le Intel® Arria® 10 Hard IP pour PCI Express*, vous verrez les avertissements suivants pendant l’analyse et l’élaboration lors de l’utilisation du logiciel Intel® Quartus® II ou Intel® Quartus® Prime Standard.

    Avertissement (10240) : avertissement Verilog HDL Always Construct à altpciexpav128_txresp_cntrl.v(344) : inférisation du loquet(es) pour « payload_limit_cntr » variable, qui maintient sa valeur précédente dans un ou plusieurs chemins à travers la construction toujours
    Info (10041) : loquet inféré pour « payload_limit_cntr[0] » à altpciexpav128_txresp_cntrl.v(344)
    Info (10041) : loquet inféré pour « payload_limit_cntr[1] » à altpciexpav128_txresp_cntrl.v(344)
    Info (10041) : loquet inféré pour « payload_limit_cntr[2] » à altpciexpav128_txresp_cntrl.v(344)
    Info (10041) : loquet inféré pour « payload_limit_cntr[3] » à altpciexpav128_txresp_cntrl.v(344)

    Résolution

    Ces avertissements peuvent être ignorés en toute sécurité et ont été corrigés dans Intel® Quartus® logiciel Prime Pro à partir de la version 16.1.

    Produits associés

    Cet article concerne 4 produits

    FPGA Intel® Cyclone® 10 GX
    FPGA Intel® Arria® 10 GT
    FPGA Intel® Arria® 10 GX
    FPGA SoC Intel® Arria® 10 GX

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    Avertissement

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