ID de l'article: 000083947 Type de contenu: Dépannage Dernière révision: 08/11/2019

Pourquoi la conception de l’exemple « Compute Score » OpenCL™ reste-t-elle sur le Intel® Programmable Acceleration Card D5005 ?

Environnement

  • Intel® Quartus® Prime Pro Edition
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Si vous exécutez l’exemple OpenCL™ « compure_score » de conception sur le Intel® Programmable Acceleration Card D5005, vous trouverez peut-être que la conception de l’exemple est suspendue et ne produit pas de résultats.  Il est possible que vous voyiez quelque chose de semblable à ce qui suit :

    [root@localhost bin]#./host

    RAND_MAX : 2147483647

    Affecter et configurer les données

    Création de documents total_terms=108157184 (no_pad=91552735)

    Créer un profil

    ...

    Configurer OpenCL

    Plateforme : Intel® FPGA SDK pour OpenCL™

    Utiliser un ou plusieurs périphériques

    pac_s10_dc : plateforme Intel PAC (pac_ee00000)

    Utiliser AOCX : compute_score.aocx

    Temps de compilation du noyau : 0,016351 ms

    .......................................... restez ici et ne pouvez pas obtenir de résultat..........||''

     

    Cela s’explique par le fait que la compilation de reconfiguration partielle (PR) à l’aide d’OpenCL™ peut produire des violations du délai de blocage dans les régions statiques. Vous pouvez trouver les fichiers « afu_default.failing_clocks.rpt/afu_default.failing_paths.rpt » dans le dossier de sortie.

    Résolution

    Pour contourner ce problème, vous devez le recompiler à l’aide d’une autre graine avec la commande : aoc -seed=. Par exemple : aoc hello_world.cl -seed=5.

    Ce problème devrait être résolu dans une prochaine version de la pile d’accélération Intel® pour Intel Xeon® processeur avec FPGAs.
     

    Produits associés

    Cet article concerne 2 produits

    FPGA PAC Intel® D5005
    FPGA SoC Intel® Stratix® 10 GX

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