ID de l'article: 000081150 Type de contenu: Information et documentation de produit Dernière révision: 05/04/2013

Comment configurer et implémenter la fonctionnalité cascading Altera_PLL ?

Environnement

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descriptif

Par rapport à la cascade PLL conventionnelle ; la fonction cascading Altera_PLL utilise un chemin d’horloge en cascade dédié entre deux fPLLs pour obtenir de meilleures performances de gigue et économiser les ressources mondiales d’horloge.

Téléchargez ce document pratique pour apprendre la configuration en cascade Altera_PLL en utilisant la mégafunction et la mise en œuvre.

Produits associés

Cet article concerne 2 produits

FPGA SoC Cyclone® V SE
FPGA et FPGA SoC Cyclone® V

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