ID de l'article: 000080779 Type de contenu: Dépannage Dernière révision: 16/11/2020

Pourquoi l’horloge générée n’est-elle pas correcte lorsque plusieurs instances P-Tile Intel® P-Tile sont Avalon® en streaming pour les instances PCI Express ?

Environnement

  • Intel® Quartus® Prime Pro Edition
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans la version 20.3 du logiciel Intel® Quartus® Prime Pro Edition, il est possible que les horloges PCIe ne soient pas générées correctement en cas de plusieurs Avalon® Intel P-Tile de streaming pour les instances PCI Express ayant des configurations différentes. Ce problème se produit dans les conceptions ciblant Intel Agilex® périphériques (P-Tile). Le fichier SDC généré par IP comprend des wildcards permettant de faire correspondre la trajectoire de l’horloge. Seul le premier fichier SDC de PCIe IP est lu correctement.

    Résolution

    Pour contourner le problème, utilisez le fichier SDC ci-joint pour remplacer celui généré dans l’instance <IP>/intel_pcie_ptile_ast_310/synth/intel_ptile_pcie.sdc.

    intel_ptile_pcie.sdc

    Le problème est résolu dans la version 20.4 du logiciel Intel® Quartus® Prime Pro Edition.

    Produits associés

    Cet article concerne 1 produits

    FPGA et FPGA SoC Intel® Agilex™ 7 série F

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