Le simulateur Modelsim 5.8 SE tombe en panne et disparaît lorsque vous chargez une conception HDL Verilog contenant un generate bloc qui fait référence à un nom de conception (tel que le port d’un module) qui n’est pas déclaré comme wire type.
Dans le cadre d’un travail, créez un nouveau fil et attribuez le fil au nom de conception. Dans le generate bloc, reportez-vous à ce fil.
Ce problème a été résolu dans la version 6.0 du simulateur Modelsim.