ID de l'article: 000080659 Type de contenu: Dépannage Dernière révision: 08/02/2017

Pourquoi le cœur IP Ethernet faible latence de 40 à 100 Gbit/s indique-t-il une erreur de longueur de charge utile pour les trames RX ayant une taille de charge utile inférieure à 46 octets ?

Environnement

  • Intel® Quartus® Prime Standard Edition
  • Intel® Quartus® Prime Pro Edition
  • Édition d'abonnement Intel® Quartus® II
  • Ethernet faible latence 40G 100G
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Le cœur IP Ethernet Faible latence de 40 à 100 Gbit/s interprète incorrectement toute valeur dans le champ de longueur d’un paquet dont la taille de charge utile est inférieure à 46 octets comme une erreur. Ce problème se produit parce que le cœur IP ne permet pas de manière adéquate le cas dans lequel le partenaire de liaison Ethernet a fléché une courte charge utile avec des octets de traitement du traitement au fur et à mesure que le protocole Ethernet l’exige.

     

    Exemple:

    Charge utile réelle = 17 octets

    Taille minimale de la charge utile = 17 octets 29 octets avec 46 octets

    Champ de longueur = 17 octets

    17 octets < 46 octets, ce qui provoque que le cœur IP signale une erreur de longueur de charge utile incorrecte

    Résolution

    Le problème sera traité dans une future version du cœur IP Ethernet Faible latence 40-100 Gbit/s.

    Produits associés

    Cet article concerne 7 produits

    FPGA et FPGA SoC Intel® Arria® 10
    FPGA Intel® Arria® 10 GT
    FPGA Intel® Arria® 10 GX
    FPGA SoC Intel® Arria® 10 GX
    FPGA Stratix® V E
    FPGA Stratix® V GS
    FPGA Stratix® V GX

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