ID de l'article: 000079779 Type de contenu: Information et documentation de produit Dernière révision: 15/04/2013

Comment simuler des conceptions Stratix V en VHDL à l’aide du logiciel ModelSim-Altera Starter Edition ?

Environnement

  • Édition d'abonnement Intel® Quartus® II
  • Simulation
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans les versions 6.6c et 6.6d du logiciel ModelSim-Altera Starter Edition, les conceptions en VHDL ciblant Stratix® périphériques V ne peuvent pas être simulées. Ce problème n’affecte pas le logiciel ModelSim-Altera Edition. Ces versions de ModelSim-Altera Starter Edition sont fournies avec les versions 10.1 et 11.0 de la suite de conception complètes Altera.

    En raison de ce problème, il est possible que vous voyiez des erreurs telles que les suivantes :

    # ALTERA version supports only a single HDL
    # ** Fatal: (vsim-3612) Instantiation of 'stratixv_ds_coef_sel' failed. Unable to check out Verilog simulation license.
    Résolution

    Pour contourner ce problème, utilisez une des options suivantes :

    • Simulez votre ciblage de conception Stratix les périphériques V à l’aide de Verilog HDL.
    • Simulez votre ciblage de conception Stratix les périphériques V à l’aide du logiciel ModelSim-Altera Edition.

    Ce problème est résolu à partir de la version 10.0c du logiciel ModelSim-Altera Starter Edition fournie avec la version 11.1 de la suite de conception complète Altera.

    Produits associés

    Cet article concerne 4 produits

    FPGA Stratix® V GX
    FPGA Stratix® V GT
    FPGA Stratix® V GS
    FPGA Stratix® V E

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