ID de l'article: 000078852 Type de contenu: Messages d'erreur Dernière révision: 11/12/2018

Avertissement critique indiquant que les transferts d’horloge peuvent se produire pendant la phase du fitter

Environnement

    Édition d'abonnement Intel® Quartus® II
    Interfaces de mémoire avec UniPHY
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descriptif

Ce problème affecte les produits DDR2, DDR3 et QDR II.

Pour les interfaces logicielles de demi-taux sur les périphériques Arria V et Cyclone V, l’avertissement suivant peut apparaître pendant la phase du fitter :

Avertissement critique (332168) : les transferts d’horloge suivants ont affectation d’incertitude concernant l’horloge. Pour obtenir des résultats plus précis, postulez affectations d’incertitude de l’horloge ou utilisez le derive_clock_uncertainty Commande.

L’avertissement ci-dessus s’applique pour maintenir l’incertitude concernant le temps entre le domaine de l’horloge AFI et le domaine de l’adresse et de l’horloge de commande. Vous peut ne pas tenir compte de cet avertissement.

Résolution

La solution à ce problème est d’ignorer l’avertissement affiché. Vous pouvez également supprimer l’avertissement, comme décrit ci-dessous.

Ouvrez le fichier _if0_p0.sdc généré dans un éditeur et localisez la section Fitter Overconstraints du fichier.

Ajoutez les lignes suivantes à la section Fitter Overconstraints du fichier :

si {} { # Supprimer l’avertissement d’incertitude d’horloge pour la durée de hold-time : set_clock_uncertainty -de [get_clocks ] à [get_clocks ] -add -hold 0.000 }

Enregistrez les modifications dans le fichier.

 

 

Produits associés

Cet article concerne 2 produits

FPGA et FPGA SoC Cyclone® V
FPGA et FPGA SoC Arria® V

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