Pourquoi est-ce que je vois des violations de synchronisation de...

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En raison d’un problème avec le fichier de contraintes de conception de synopsys (.sdc) généré automatiquement pour le fichier megaCore de niveau 4 (récepteur) Altera® POS-PHY® (Récepteur), vous pouvez voir des violations de synchronisation de récupération sur des chemins allant de "*dpa_align:dpa_align|dpa_reset" "*altlvds_rx_component|*auto_generated|rx*bit_slip_reg" .

Cela est dû aux affectations .sdc générées automatiquement suivantes qui sont ignorées :

Pour contourner ce problème, vous pouvez remplacer les affectations ci-dessus (qui se trouvent dans le fichier .sdc généré automatiquement) par les affectations suivantes :

set_multicycle_path -setup -end -from [get_keepers {*dpa_align:dpa_align|dpa_reset}] -to [get_keepers {*altlvds_rx_component|*auto_generated|rx*~bit_slip_reg}] 2 set_multicycle_path -hold -end -from [get_keepers {*dpa_align:dpa_align|dpa_reset}] -to [get_keepers {*altlvds_rx_component|*auto_generated|rx*~bit_slip_reg}] 1

Ce problème devrait être résolu dans une version ultérieure de la Altera Suite de conception complète.

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Pourquoi est-ce que je vois des violations de synchronisation de récupération dans le Altera MegaCore de niveau 4 Pos-PHY dans ma conception ?

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