ID de l'article: 000077600 Type de contenu: Dépannage Dernière révision: 03/01/2013

Pourquoi mon Stratix V PCIe Gen 2 peut-il concevoir une déformation intermittente à la vitesse Gen1 ?

Environnement

  • Édition d'abonnement Intel® Quartus® II
  • PCI Express*
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un bogue dans le logiciel Quartus® II, il est possible que vous constatiez votre Stratix® V PCIe® de conception 2e génération de génération 2 à gen 1.

    Ce problème concerne uniquement les périphériques Stratix V et les versions du logiciel Quartus II jusqu’à la version 12.0 SP2 et y compris.

    Résolution

    Pour contourner ce problème, passez au logiciel Quartus II version 12.0 SP2, puis téléchargez et installez le correctif de périphérique 2.dp5 ou plus à partir de la solution connexe ci-dessous.

    Comme indiqué dans le fichier Readme de ce correctif de périphérique, vous devrez effectuer les étapes suivantes pour appliquer avec succès cette solution :

    1. Ajoutez les paramètres QSF suivants :

    nom set_instance_assignment XCVR_RX_SD_ON 1 à
    nom set_instance_assignment XCVR_RX_SD_OFF 5 à
    set_instance_assignment nom XCVR_RX_SD_THRESHOLD 4
    set_instance_assignment nom XCVR_RX_COMMON_MODE_VOLTAGE VTT_0P70V à

    2. Le contrôleur de reconfiguration IP PHY doit être connecté à l’IP PCIe

    G1/G2 : Suppression du décalage d’utilisation ACTIVÉE

    3. Le resserrez l’IP PCIe

    4. Recompile la conception

    Ce problème doit être résolu dans une prochaine version du logiciel Quartus II.

    Solution connexe :

    http://www.altera.com/support/kdb/solutions/rd08232012_334.html

    Produits associés

    Cet article concerne 3 produits

    FPGA Stratix® V
    FPGA Stratix® V GX
    FPGA Stratix® V GT

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