ID de l'article: 000077382 Type de contenu: Dépannage Dernière révision: 13/05/2019

Nœud: <hierarchy>|gen_ct1_hssi_pldadapt_rx.inst_ct1_hssi_pldadapt_rx~aib_rx_internal_div.reg a été déterminée comme une horloge, mais a été trouvée sans affectation associée à l’horloge.</hierarchy>

Environnement

  • Intel® Quartus® Prime Pro Edition
  • Émetteur-récepteur PHY
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans la version 17.1 et antérieure du logiciel Intel® Quartus® Prime Pro Edition, il est possible que vous rencontriez cet avertissement pendant l’analyse du timing en cas d’instanciation de plusieurs instances de l’IP PHY natif de l’émetteur-récepteur Intel® Stratix® 10 FPGA dans votre conception.

    Le problème est spécifique aux cas où les noms d’instance IP de l’émetteur-récepteur Native PHY Intel® Stratix® 10 FPGA comprennent des supports carrés regroupant plusieurs chiffres.

    Par exemple :

    « my_instance[0].u0 » fonctionnerait bien.

    « my_instance[10].u0 » entraînerait l’erreur


    Les noms d’instance contenant des supports carrés sont le résultat commun de l’utilisation de générer des déclarations pour instantanéiser plusieurs instances du même composant.

    Résolution

    Pour contourner ce problème, veillez à ce que les noms d’instance IP de votre émetteur-récepteur Native PHY Intel® Stratix® 10 FPGA n’incluent pas de supports carrés contenant plusieurs chiffres.

    Ce problème devrait être résolu dans une version ultérieure du logiciel Intel Quartus Prime Pro Edition.

    Produits associés

    Cet article concerne 1 produits

    FPGA et FPGA SoC Intel® Stratix® 10

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