ID de l'article: 000077155 Type de contenu: Dépannage Dernière révision: 20/01/2015

Pourquoi une mémoire M20K affiche-t-elle incorrectement l’état d’erreur sur le port eccstatus lorsque les données de contenu initiales sont lues ?

Environnement

  • Édition d'abonnement Intel® Quartus® II
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    Descriptif

    En raison d’un problème dans la version 14.0 du logiciel Quartus® II et les versions précédentes, il est possible qu’une mémoire M20K affiche incorrectement l’état d’erreur sur le port eccstatus lorsque le M20K est utilisé comme une RAM à 2 ports avec les deux options suivantes et que les données de contenu initiales sont lues dans Stratix® V FPGAs.

    • Activez le code de correction d’erreurs (ECC) pour vérifier et corriger les erreurs en un seul bit, les erreurs double bit adjacentes et de détecter trois erreurs bits adjacentes dans l’onglet Clks/Rd,Byte En
    • Oui, utilisez ce fichier pour les données de contenu mémoire dans l’onglet Mem Init

    L’erreur s’affiche uniquement lorsque les données de contenu initiales sont lues. Une fois que les données de contenu initiales sont écrasées par les nouvelles données par le fonctionnement en écriture, le port eccstatus produit l’état correct pour les nouvelles données.

    Résolution

    Pour contourner ce problème, utilisez 512 mots de profondeur de mémoire, quelle que soit la profondeur de mémoire cible. Notez que si votre profondeur de mémoire cible est inférieure à 512 mots, vous devez connecter les entrées de MSB supplémentaires de l’adresse d’écriture et de lecture à la logique dysique pour éviter qu’elles ne soient synthétisées.

    Pour résoudre ce problème, téléchargez et installez le correctif 4.50 pour le logiciel Quartus® II version 13.1.4 à partir des liens suivants.

    Ce problème est résolu à partir de la version 14.1 du logiciel Quartus II.

    Produits associés

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    FPGA Stratix® V

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