ID de l'article: 000076956 Type de contenu: Dépannage Dernière révision: 16/02/2016

Seriallite III a des violations de synchronisation sur deux horloges non retélérables pour le signal d’entrée crc_error_inject

Environnement

    Édition d'abonnement Intel® Quartus® II
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Descriptif Les versions 13.1 et antérieures de Serialite III MegaCore peuvent montrer des violations de synchronisation dans TimeQuest entre deux horloges différentes. Les violations de synchronisation impliquent le signal d’entrée, crc_error_inject. Le Guide de l’utilisateur de Seriallite III demande à l’utilisateur d’utiliser le « tx_user_clock » pour piloter le signal « crc_error_inject ». Comme le signal crc_error_inject n’est pas synchronisé avec l’horloge correcte à l’intérieur du cœur Seriallite III, les violations de synchronisation sont signalées.
Résolution

Les versions 13.1 et plus anciennes de Seriallite III MegaCores doivent utiliser une horloge interne pour synchroniser le signal d’entrée crc_error_inject.  Le chiffre suivant montre la solution à ce problème.

Figure 1.

L’utilisateur doit acheminer l’horloge interne, « tx_coreclkin » au module de haut niveau en créant des ports de sortie dans la hiérarchie.  Dans la conception de haut niveau de l’utilisateur, l’horloge « tx_coreclkin » peut ensuite être utilisée pour piloter le signal d’entrée « crc_error_inject ».

En supposant un nom d’instance Seriallite III de « sl3 » et la conception de haut niveau d’un utilisateur en tant que top, voici les étapes à suivre pour mettre en œuvre la solution ci-dessus.

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