Intel® Cyclone® kit de développement V GT ne peut pas être configuré lors de l’utilisation d’un flux de bits compressé en mémoire Flash en raison de la Intel® MAX®V a lié un du bit MSEL à 0.
Modifiez la conception Intel® Max® V sur pfl_control.vhd qui se trouve dans le dossier « hdl » du dossier d’installation du kit de développement.
Allez à la ligne 397, vous observerez (msel < = « ZZZ0Z » ;). Changez-le (msel <= « ZZZZZ » ;).
Cela permet de sélectionner le MSEL en fonction du commutateur DIPSW (DIP Switch) de la carte. Assurez-vous que la sélection MSEL correcte est en fonction de son mode de configuration.