ID de l'article: 000075068 Type de contenu: Dépannage Dernière révision: 11/02/2013

Pourquoi vois-je les horloges de sortie megafunction Altera_PLL fonctionner de manière intermittente dans une simulation fonctionnelle ?

Environnement

  • Édition d'abonnement Intel® Quartus® II
  • Simulation
  • PLL
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif En raison d’un problème dans les versions 10.0 et ultérieures du logiciel Quartus® II, vous pouvez voir les horloges de sortie d’une mégafunction Altera_PLL fonctionner de manière intermittente dans une simulation fonctionnelle même si le signal bloqué est signalé.  Il est possible que vous voyiez des pannes périodiques des horloges de sortie en fonction de la valeur calculée de la fréquence du VCO. Ce problème se produit parce que le modèle de simulation est limité à une résolution ps pour le Altera_PLL.
    Résolution Si vous êtes affecté par cette limitation lors de la simulation de la mégafunction Altera_PLL, ajustez la période d’horloge d’entrée en augmentant ou en réduisant la période d’horloge d’entrée par incréments de 2 ps dans le banc de test de simulation jusqu’à ce que la période de VCO puisse être calculée à l’intérieur d’une résolution prise en charge par les modèles de simulation.

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