ID de l'article: 000074421 Type de contenu: Dépannage Dernière révision: 26/05/2017

Pourquoi ne puis-je pas programmer le périphérique de configuration EPCQ-L avec un fichier .jic sur un kit de développement SoC Intel® Arria® 10 ?

Environnement

  • Intel® Quartus® Prime Pro Edition
  • Programmateur Intel® Stand-Alone 10.23 (pour ancien logiciel Max+Plus® II)
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Vous pouvez voir le message d’erreur suivant dans le programmeur logiciel Intel® Quartus® Prime lors de la programmation du périphérique de configuration EPCQ-L avec un fichier .jic sur une révision B Intel® Arria® 10 Kit de développement SoC.

    Erreur (209012) : Fonctionnement défectueux. CONF_DONE ne sont pas parvenues à atteindre un niveau élevé

    Par défaut, la chaîne JTAG du kit de développement se compose d’un Intel Arria de 10 FPGA, de son HPS et d’un périphérique MAX® V (le CPLD MUX D’E/S). En outre, la fréquence TCK du Intel® FPGA Download Cable II embarquée par défaut à 24 MHz

    Comme la période minimale de TCK JTAG pour MAX les périphériques V est de 100 ns, il s’agit du périphérique lent de la chaîne JTAG et contribue à la défaillance de la configuration.

     

    Résolution

    Pour programmer avec succès le périphérique EPCQ-L sur le kit de développement SoC Intel Arria 10 avec un fichier .jic, procédez comme suit :

    • Tout en programmant avec les paramètres par défaut de la carte (Intel Arria les périphériques 10 et MAX V activés dans la chaîne JTAG) réduisez l’horloge JTAG à 6 MHz avec la commande : « jtagconfig --setparam < nom JtagClock 6M »
    • Retirez le MAX CPLD V de la chaîne en plaçant le troisième bit de DIP SW3 sur la position DÉSACTIVÉe.

    Produits associés

    Cet article concerne 2 produits

    FPGA et FPGA SoC Intel® Arria® 10
    CPLD MAX® V

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