ID de l'article: 000074116 Type de contenu: Dépannage Dernière révision: 05/02/2013

Pourquoi la résolution de changement de phase pour la mégafunction ALTPLL dans la simulation RTL est-elle différente de la valeur prévue ?

Environnement

  • Édition d'abonnement Intel® Quartus® II
  • Simulation
  • PLL
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Lors de la simulation RTL de la mégafuction ALTPLL, la résolution de l’étape de transfert de phase peut être différente de la valeur prévue lorsque le type de PLL est défini sur « AUTO » en mettant en marche l’option Select the PLL type automatiquement dans le gestionnaire de plug-in ALTPLL MegaWizard®. Dans ce cas, le modèle de simulation peut choisir une fréquence de VCO différente de la mégafunction ALTPLL, et l’étape de phase est incorrecte.

    Ce problème n’effectue pas la simulation au niveau des portes en utilisant la mégafunction ALTPLL.

    La résolution correcte de l’étape du changement de phase peut être déterminée par calcul. Reportez-vous au guide de l’utilisateur megafunction du circuit à verrouillage de phase (ALTPLL,Dynamic Phase Reconfiguration)(PDF), dans le chapitre Dynamique de la reconfiguration de la phase. D’après ce Guide de l’utilisateur, l’étape de transfert de phase de la phase de toux est 1/8e de la fréquence de VCO de la PLL.

    Résolution Pour contourner ce problème, activez le(s) fichier(s) de sortie (Create output) à l’aide de l’option \'Advanced\' PLL Parameters (Paramètres PLL avancés) sur la page Entrées/Verrouillage du Gestionnaire de plug-in ALTPLL MegaWizard.

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