ID de l'article: 000073890 Type de contenu: Information et documentation de produit Dernière révision: 13/11/2019

Comment éviter le blocage de dépendance ACP dans le SoC Intel® Cyclone® V, le SoC Arria®V et le SoC Arria®10

Environnement

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Sous certaines conditions, vous pouvez avoir un blocage de dépendance ACP dans les SoC Arria® et Cyclone®. Voici quelques exemples de scénarios sur la façon dont cela pourrait se produire :

    1. Le processeur ARM accède à FPGA fabric à l’aide d’un accès mémoire de périphérique. Ce type d’accès entraîne le blocage du pipeline du processeur jusqu’à ce que l’accès soit terminé.
    2. La machine d’état FPGA fabric émet un accès cohérent au HPS sur ACP pour pouvoir répondre à l’accès HPS.
    3. L’ACP reçoit l’accès, mais il nécessite que SCU effectue une opération de maintenance du cache pour le terminer. Cependant, l’opération de maintenance du cache ne peut pas être terminée car le pipeline du processeur est bloqué : le système est bloqué.

    Résolution

    Évitez d’avoir à accéder de manière cohérente au HPS via ACP à partir de la structure pour accéder à l’accès complet provenant de HPS, car cela pourrait entraîner une situation d’impasse.

    Vous pouvez obtenir le même résultat en divisant la fonctionnalité en plus petits morceaux. Par exemple, lancez une opération avec accès, puis utilisez un deuxième accès pour déterminer l’état de l’opération.

    Produits associés

    Cet article concerne 3 produits

    FPGA SoC Arria® V SX
    FPGA SoC Cyclone® V SX
    FPGA SoC Intel® Arria® 10 GX

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