ID de l'article: 000073711 Type de contenu: Dépannage Dernière révision: 11/09/2012

Quelle est la spécification minimale de synchronisation de la largeur d’impulsion du signal clair asynchrone pour Cyclone bloc mémoire III M9K (TM9KCLR) ?

Environnement

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descriptif

La spécification minimale de synchronisation de la largeur du pouls du signal clair asynchrone pour Cyclone® bloc mémoire III M9K (TM9KCLR) sur les échelons de vitesse est les suivantes :

 

C6 = 371ps

C7 = 379ps

C8 = 378ps

 

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FPGA Cyclone® III

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