VHDL : RAM à port unique

author-image

Par

Cet exemple décrit une mémoire vive 8 bits 64 bits à port unique avec des adresses de lecture et d’écriture communes dans VHDL. Les outils de synthèse sont capables de détecter les modèles de RAM à port unique dans le code HDL et d’inférer automatiquement l’altsyncram ou les mégafunctions altdpram, en fonction de l’architecture du périphérique cible.

Figure 1. Schéma de haut niveau de la RAM à port unique.

Téléchargez les fichiers utilisés dans cet exemple :

L’utilisation de cette conception est régie par les conditions générales du contrat de licence d’Intel® Design Example et est soumise.

Le contenu de cette page est une combinaison de traduction humaine et informatique du contenu original en anglais. Ce contenu vous est fourni pour votre commodité et à titre informatif seulement et ne saurait être totalement exact ou complet. En cas de contradiction entre la version anglaise de cette page et la traduction, c'est la version anglaise qui prévaut. Afficher la version anglaise de cette page.