FPGA Intel® IP pour streaming série Lite III
Le cœur Serial Lite III Streaming Intel® FPGA Intellectual Property (IP) offre une connectivité simple qui permet de transférer des données point à point rapidement sur divers supports de transmission, notamment des circuits imprimés (PCB), des fonds de panier, des câbles en cuivre et de la fibre optique.
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FPGA Intel® IP pour streaming série Lite III
Serial Lite III est un protocole simple, à faible latence et évolutif pour les applications de transfert de données série à large bande passante.
Le cœur Serial Lite III Streaming Intel® FPGA IP intègre des émetteurs-récepteurs de technologie Intel :
- Attachement au support physique (PMA)
- Sous-couche de codage physique (PCS)
- Couches MAC (Media Access Control)
Les couches PCS et PMA sont renforcées au sein des FPGA Intel® Stratix® 10, Intel® Arria® 10, Stratix® V et Arria® V afin que les clients économisent de précieuses ressources FPGA logiques.
Caractéristiques
La fonctionnalité PCS/PMA renforcée facilite la fermeture de la synchronisation pour tous les types de conception. Le protocole Serial Lite III a été conçu pour offrir la fiabilité, la faible latence, les frais et l'évolutivité nécessaires afin de garantir que les transferts de données soient efficaces et que les taux d'erreurs sur les bits soient faibles, comme l'exigent les systèmes actuels et de la prochaine génération.
- Sélection du débit de données jusqu'à 28 Gbit/s
- Configuration multi-voies jusqu'à 24 voies
- Opérations de diffusion de données - continue ou en rafale
- Opérations simplex et full duplex
- Mode de synchronisation utilisateur flexible
- Avantage d'une utilisation renforcée des ressources
- Transfert de données à faible latence (< 150 ns : TX + RX)
- Frais de transmission minimes
- schéma d'encodage/de décodage 64B/67B
- Prise en charge optionnelle du code de correction d'erreurs (ECC) sur les M20K (atténuation des SEU)
- Injection ou détection d'erreurs et surveillance de la santé en option
- IP entièrement intégrée (couches MAC, PCS et PMA)
- Paramètres de préaccentuation et d'égalisation réglables
- Prise en charge du couplage AC et DC
Performances et productivité escomptées
Performances |
Productivité |
---|---|
Efficacité du débit de données élevé |
Marge de synchronisation IP adéquate pour accélérer la fermeture complète de la période de conception |
Plus de 300 Gbit/s de bande passante agrégée pour les applications actuelles et émergentes (jusqu'à 24 voies) |
La caractéristique Intel FPGA IP Evaluation Mode vous permet de tester l'IP gratuitement et sans licence |
Transferts de données à faible latence (< 150 ns : TX + RX) |
L'IP Serial Lite III entièrement intégrée comprend des couches MAC, PCS et PMA pour faciliter l'intégration du FPGA Intel IP |
Le couplage AC et DC permet de régler la (les) voie(s) pour améliorer les taux d'erreurs de bit. |
Statut IP
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Statut de commande |
Production |
Codes de commande | |
FPGA Intel® IP pour streaming série Lite III |
IP-SLITE3/ST |
Exemples de conception matérielle d'un bouton-poussoir dans le logiciel Intel Quartus Prime
Voir aussi…
Documentation
- Directives relatives à la synchronisation de la fonction Intel® FPGA IP pour streaming série Lite III pour les FPGA Intel® Arria® 10 et série V ›
(Pour accéder à ce document, contactez votre représentant commercial Intel® FPGA local)
- Calculateur d'efficacité des données de la fonction Intel® FPGA IP pour streaming série Lite III pour les FPGA Intel® Arria® 10 et série V ›
(Pour accéder à ce document, contactez votre représentant commercial Intel® FPGA local)
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