Cœur IP du FPGA Intel® SDI II
Le cœur de propriété intellectuelle (IP) de l'interface numérique série (SDI) II du FPGA Intel met en œuvre un émetteur, un récepteur ou un SDI full-duplex répondant à la norme, en haute définition ou avec un débit de 3G à 12G, tel que défini par la Society of Motion Picture and Television Engineers. Le cœur IP SDI II prend en charge plusieurs normes. Ces modes permettent de détecter automatiquement le débit de réception et de reconfigurer l'émetteur-récepteur de manière dynamique.
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Lire le guide de l'utilisateur SDI Audio Intel FPGA IP ›
Lire le guide de l'utilisateur de l'exemple de conception du FPGA Intel® Arria® 10 IP SDI II ›
Lire le guide de l'utilisateur de l'exemple de conception du FPGA Intel® Stratix® 10 IP SDI II ›
Lire le guide de l'utilisateur de l'exemple de conception du FPGA Intel® Cyclone® 10 IP GX SDI II ›
Cœur IP du FPGA Intel® SDI II
Caractéristiques
Caractéristiques du cœur IP |
Descriptif |
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Interface de données de l'émetteur-récepteur |
20 bit, 40 bit et 80 bit |
Normes SDI et formats vidéo pris en charge
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Remarque : tous les appareils prennent pas en charge tous les formats, consultez la « Gestion des périphériques » ci-dessous |
Prise en charge SMPTE |
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Autres caractéristiques
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Gestion des dispositifs
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Norme unique |
Normes multiples |
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Famille d'appareils |
SD-SDI |
HD-SDI |
3G-SDI |
Double lien HD-SDI |
Norme double (jusqu'à HD) |
Norme triple (jusqu'à 3G) |
Norme multi (jusqu'à 12G) |
F-tile Intel® Agilex™ | - | ✓ | ✓ | - | ✓ | ✓ | |
Intel® Stratix® 10 |
- |
✓ |
✓ |
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- |
✓ |
✓ |
Intel® Cyclone® 10 |
- |
✓ |
✓ |
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- |
✓ |
✓ |
Intel® Arria® 10 |
- |
✓ |
✓ |
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- |
✓ |
✓ |
Stratix® V |
✓ |
✓ |
✓ |
✓ |
✓ |
✓ |
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Cyclone® V |
✓ |
✓ |
✓ |
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Arria® V GX |
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✓ |
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Arria® V GZ |
✓ |
✓ |
✓ |
✓ |
✓ |
✓ |
- |
Mesures de qualité IP
Basique |
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L'année IP a été publiée |
2006 |
Dernière version du logiciel Intel® Quartus® Prime supportée ? |
Oui |
Statut |
Production |
Livrables |
|
Les livrables des clients comprennent les éléments suivants :
|
|
Tout livrable de clients supplémentaire fourni avec l'IP |
Aucun |
GUI de paramétrage permettant à l'utilisateur final de configurer l'IP |
Oui |
Le cœur IP est activé pour le support du mode d'évaluation du FPGA Intel IP |
Oui |
Langage source |
Verilog et VHDL |
Langage Testbench |
Verilog et VHDL |
Pilotes logiciels fournis |
Non |
Assistance du système d'exploitation (SE) du pilote |
— |
Mise en œuvre |
|
Interface utilisateur |
Autre (vidéo parallèle) |
Métadonnées IP-XACT |
Non |
Vérification |
|
Simulateurs pris en charge |
ModelSim*, VCS, Riviera-PRO, Xcelium |
Matériel validé |
Intel® Stratix® 10, Intel® Cyclone® 10, Intel® Arria® 10, Stratix® V, Cyclone V, Arria V GX/GZ |
Réalisation de tests de conformité aux normes industrielles |
Non |
Si oui, quel(s) test(s) ? |
— |
Si oui, sur quel(s) dispositif(s), FPGA Intel ? |
— |
Si oui, date exécutée |
— |
Si non, est-il planifié ? |
Non |
Interopérabilité |
|
L'IP a passé des tests d'interopérabilité |
Oui |
Si oui, sur quel(s) dispositif(s), FPGA Intel ? |
Intel® Stratix® 10, Intel Cyclone 10, Intel Arria 10, Stratix V, Cyclone V, Arria V |
Rapports d'interopérabilité disponibles |
Contact commercial |
Exemples de conception et kits de développement
Les exemples de conception suivants sont disponibles pour que vous puissiez les exécuter sur nos kits de développement. |
||||
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Exemple de conception |
Kits de développement pris en charge |
Carte fille |
Plainte relative à Platform Designer |
Fournisseur |
Manuel d'utilisation de l'exemple de conception du FPGA Intel SDI II pour les appareils Intel® Arria® 10 Conception de référence SDI Multi-rate (jusqu'à 12G) pour les appareils Intel® Arria® 10 |
Kit de développement du FPGA Intel Arria 10 GX |
Carte fille Terasic SDI-FMC |
Oui |
Intel |
Exemple de conception générée par Intel® Quartus® (Stratix V, Arria V, Cyclone V) Documentation située dans le manuel d'utilisation du cœur IP Intel FPGA SDI II |
Oui |
Intel |
||
Manuel d'utilisation de la conception de référence audio 12G-SDI |
Vidéos
Le cœur IP SDI II présente
Cette vidéo présente un système 12G-SDI basé sur un FPGA Intel® Arria® 10 transmettant de manière fiable une vidéo 4K à 60 images par seconde.
Manuel de mise en œuvre pas à pas de l'IP d'un SDI II pour un appareil Intel® Arria® 10
Cette vidéo montre comment mettre en œuvre un cœur IP SDI II dans un appareil Intel Arria 10. Vous apprendrez la génération pas à pas dans le logiciel Intel® Quartus® Prime pour tous les composants et intégrations liés à l'émetteur-récepteur.
Mise en œuvre des caractéristiques de commutation de l'horloge SDI II Dynamic TX et vérification matérielle
Cette vidéo présente la théorie de fonctionnement et une démonstration de la mise en œuvre de la capacité de commutation de l'horloge SDI II Dynamic TX pour les appareils Intel Arria 10.
Vidéo de démonstration de la conception de la retransmission multi-débit SDI par le FPGA Intel® Agilex™
FPGA Intel® Agilex™ F-Tile permet à l'IP SDI de prendre en charge le SD-SDI jusqu'à 12G-SDI. Cette démonstration exécute la conception de retransmission multi-débit SDI sans VCXO externe sur le Kit de développement SoC d'émetteur-récepteur du FPGA Intel® Agilex™ série I.
Voir aussi…
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