Intel® FPGA IP pour PCIe*
Le protocole PCI Express (PCIe*) est un protocole série haute performance, évolutif et riche en fonctionnalités qui offre des taux de transfert de données allant de 2,5 gigatransferts par seconde (GT/s) à 32 GT/s et au-delà. La propriété intellectuelle (IP) Intel® FGPA pour PCIe continue de croître à mesure que l'organisation PCI-SIG fournit de nouvelles générations de spécifications. Intel est membre du PCI-SIG depuis 1992 et participe aux ateliers de conformité de l'organisation pour chaque nouvelle génération de silicium afin de garantir leur interopérabilité et leur conformité aux normes industrielles actuelles.
Intel® FPGA IP pour PCIe*
Les solutions IP PCIe comprennent la pile de protocoles renforcée PCIe d'Intel à la pointe de la technologie, qui incluent les couches de transactions et de liaison de données ainsi qu'une couche physique renforcée. Cette dernière comprend à la fois le support physique (PMA, Physical medium attachment) et la sous-couche de codage physique (PCS). L'IP PCIe d'Intel comprend également des blocs IP logiciels optionnels, notamment des moteurs d'accès à la mémoire directe (DMA) et la virtualisation des E/S single-root (SR-IOV). Cette combinaison unique d'IP renforcée et logicielle offre des performances et une flexibilité supérieures pour une intégration optimale.
Intel propose des solutions IP PCIe basées sur la fonction Intel® FPGA® IP qui ont évolué suivant la feuille de route du protocole PCI-SIG.
- Prise en charge de jusqu'à 3 x 8 avec IP matérielles sur les appareils Intel® Arria® 10 et Intel® Cyclone® ›
- Prise en charge de jusqu'à 16 PCIe 3.0 avec IP matérielle tuile L/H ›
- Prise en charge de jusqu'à 16 PCIe 4.0 avec IP matérielle tuile P ›
- Prise en charge de jusqu'à 16 PCIe 4.0 et Ethernet 400G avec IP matérielle tuile F ›
- Prise en charge de jusqu'à 16 PCIe 5.0 avec IP matérielle tuile R ›
Intel propose également des IP logicielles complémentaires qui fonctionnent avec les IP matérielles ci-dessus basées sur les tuiles, pour effectuer les fonctions DMA et Switch PCIe.
Prise en charge des appareils et nombre de blocs IP PCIe renforcés
Famille d'appareils |
Nombre de blocs IP PCIe* renforcés |
Vitesse de liaison PCIe 1.0 (2,5 GT/s) |
Vitesse de liaison PCIe 2.0 (5,0 GT/s) |
Vitesse de liaison PCIe 3.0 (8,0 GT/s) |
Vitesse de liaison PCIe 4.0 (16,0 GT/s) |
Vitesse de liaison PCIe 5.0 (32,0 GT/s) |
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Intel® Agilex™ |
1-3 par appareil |
✓ |
✓ |
✓ |
✓ |
✓ |
Intel® Stratix® 10 |
1-4 par appareil |
✓ |
✓ |
✓ |
✓ |
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Intel® Arria® 10 |
1-4 par appareil |
✓ |
✓ |
✓ |
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Intel® Cyclone® 10 |
1 par appareil |
✓ |
✓ |
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|
Intel® Cyclone® 10 GX |
1 par appareil |
✓ |
✓ |
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Arria® V |
1-2 par appareil |
✓ |
✓ |
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Cyclone® V GT |
2 par appareil |
✓ |
✓ |
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Cyclone® V GX |
1-2 par appareil |
✓ |
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Stratix® IV |
2-4 par appareil |
✓ |
✓ |
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Cyclone® IV GX |
1 par appareil |
✓ |
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Arria® II GZ |
1 par appareil |
✓ |
✓ |
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Arria® II GX |
1 par appareil |
✓ |
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Prise en charge des configurations de périphériques et des fonctionnalités
Type d'interface |
Interface Avalon® streaming |
Avalon® memory mapped |
Avalon® memory mapped avec DMA |
SR-IOV |
CvP / PRoP |
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Appareils/Configuration |
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Intel® Agilex™ |
Point de terminaison |
Jusqu'à 5 x 16 |
Jusqu'à 5 x 16 |
Jusqu'à 5 x 16 |
Disponibles |
Jusqu'à 5 x 16 : CVP Init |
Port racine |
Jusqu'à 5 x 16 |
Jusqu'à 5 x 16 |
- |
- |
- |
|
Intel® Stratix® 10 |
Point de terminaison |
Jusqu'à 4 x 16 |
Jusqu'à 4 x 16 |
Jusqu'à 4 x 16 |
Disponibles |
Jusqu'à 4 x 16 : CVP Init |
Port racine |
Jusqu'à 4 x 16 |
Jusqu'à 4 x 16 |
- |
- |
- |
|
Intel® Arria® 10 |
Point de terminaison |
Jusqu'à 3 x 8 |
Jusqu'à 3 x 4 |
1 x 8, 2 x 4, 2 x 8, 3 x 2, 3 x 4, 3 x 8 |
Disponibles |
Jusqu'à 3 x 8 : CVP et PRoP |
Port racine |
Jusqu'à 3 x 8 |
Jusqu'à 3 x 4 |
- |
- |
- |
|
Intel® Cyclone® 10 GX |
Point de terminaison |
Jusqu'à 2 x 4 |
Jusqu'à 2 x 4 |
2x4 |
- |
Jusqu'à 2 x 4 : CVP et PRoP |
Port racine |
Jusqu'à 2 x 4 |
Jusqu'à 2 x 4 |
- |
- |
- |
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Stratix® V |
Point de terminaison |
Jusqu'à 3 x 8 |
Jusqu'à 3 x 4 |
1 x 8, 2 x 4, 2 x 8 |
Disponibles |
1 : CVP Init et CVP Update |
Port racine |
Jusqu'à 3 x 8 |
Jusqu'à 3 x 4 |
- |
- |
- |
|
Arria® V GZ |
Point de terminaison |
Jusqu'à 3 x 8 |
Jusqu'à 3 x 4 |
1 x 8, 2 x 4, 2 x 8 |
- |
1 : CVP Init et CVP Update |
Port racine |
Jusqu'à 3 x 8 |
Jusqu'à 3 x 4 |
- |
- |
- |
|
Arria® V |
Point de terminaison |
Jusqu'à 1 x 8 et 2 x 4 |
Jusqu'à 1 x 8 et 2 x 4 (no x 2) |
1 x 8, 2 x 4 |
- |
Jusqu'à 1 x 8 et 2 x 4 |
Port racine |
Jusqu'à 1 x 8 et 2 x 4 |
Jusqu'à 1 x 8 et 2 x 4 (no x 2) |
- |
- |
- |
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Cyclone® V |
Point de terminaison |
Jusqu'à 2 x 4 |
Jusqu'à 2 x 4 (no x 2) |
2x4 |
- |
Jusqu'à 2 x 4 |
Port racine |
Jusqu'à 2 x 4 |
Jusqu'à 2 x 4 (no x 2) |
- |
- |
- |
- CvP - Configuration via le protocole.
- PRoP - Reconfiguration partielle par PCIe.
- SR-IOV - Virtualisation single root des E/S.
- DMA - Accès mémoire direct.
Autres ressources
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