IP DMA multicanal PCIe* et IP du pont AVMM
L'IP DMA multicanal pour PCIe vous permet de transférer efficacement des données entre l'hôte et l'appareil. L'IP DMA multicanal pour PCIe prend en charge plusieurs canaux DMA entre l'hôte et l'appareil sur le lien PCIe* sous-jacent.
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IP DMA multicanal PCIe* et IP du pont AVMM
Un canal DMA se compose d'une paire de files d'attente de l'hôte à l'appareil (H2D) et de l'appareil à l'hôte (D2H). Comme le montre la Figure, l'IP DMA multicanal pour PCIe peut être utilisée dans l'infrastructure matérielle d'un serveur pour permettre la communication entre divers clients basés sur des machines virtuelles et leurs homologues basés sur des dispositifs FPGA. L'IP DMA multicanal pour PCIe fonctionne sur des files d'attente basées sur des descripteurs et configurées par le logiciel du pilote pour transférer des données entre le FPGA local et l'hôte. La logique de contrôle de l'IP DMA multicanal pour PCIe lit les descripteurs de file d'attente et les exécute. Des files d'attente distinctes sont utilisées pour les opérations D2H et H2D pour chaque canal. L'IP DMA multicanal pour PCIe intègre l'IP matérielle Intel® PCIe et s'interface avec le complexe racine de l'hôte via le lien PCIe. Du côté de la logique utilisateur, les interfaces Avalon® Memory-Mapped et Avalon®-Streaming de l'IP permettent d'intégrer facilement l'IP MCDMA avec d'autres composants de Platform Designer.
L'IP DMA multicanal intègre également la fonctionnalité de pont AVMM (Avalon® Memory mapped) pour les configurations de points de terminaison et de ports racine, comme le montre la Figure. Les utilisateurs peuvent profiter de la fonctionnalité de pont de façon autonome ou en conjonction avec le module MCDMA.
Caractéristiques
- Option permettant de sélectionner l'interface Avalon® Memory-mapped ou l'interface logique Avalon® streaming.
- Prend en charge jusqu'à 2 048 canaux avec prise en charge SR-IOV (8 PF / 2K VF).
- Architecture intégrée pour éviter le blocage de la tête de ligne sur n'importe quel canal.
- Notification d'achèvement par descripteur avec Writeback ou MSI.
- Prise en charge de la valeur Max Payload Size de 512 octets.
- Prise en charge de la réorganisation de l'achèvement.
Statut IP
Statut de commande |
Production |
Codes de commande |
|
FPGA Intel® IP DMA multicanal pour PCI Express |
H-Tile : IP-PCIEMCDMA P-Tile : IP-PCIEMCDMA F-Tile : IP-PCIEMCDMA |
Voir aussi…
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