Intel FPGA IP DMA multicanal pour PCI Express*
L’IP DMA multicanal pour PCI Express offre une efficacité, une vitesse et une flexibilité de configuration élevées pour prendre en charge diverses applications, du HPC, du Cloud, du réseau à l’embarqué. Avec la prise en charge de jusqu’à 2048 canaux et les pilotes PCIe basés sur Linux, cette solution à faible latence et faible utilisation des ressources est essentielle pour gérer les mouvements de gros volumes de données afin d’optimiser les performances du système.
Intel FPGA IP DMA multicanal pour PCI Express*
1. Agilex™ 5 FPGA – AXI Multichannel DMA est disponible.
- Interface logique utilisateur AXI-Stream
2 Agilex™ 7 FPGA – Deux DMA multicanaux sont disponibles – en fonction de la sélection de l’interface utilisateur.
- Interface logique utilisateur Avalon® Memory-Mapped ou Avalon® Streaming
- Interface logique utilisateur AXI-Stream
Les IP DMA multicanal offrent non seulement une variété d’interfaces logiques utilisateur comme indiqué ci-dessus, mais en conjonction avec notre PCI Express Hard IP conforme PCI-SIG*, simplifient l’intégration globale et accélèrent les cycles de conception.
Le DMA est composé de canaux composés de paires de files d’attente de l’hôte à l’appareil (H2D) et de l’appareil à l’hôte (D2H). Comme le montre la figure, le DMA multicanal peut être utilisé dans l’infrastructure matérielle d’un serveur pour permettre la communication entre divers clients basés sur une machine virtuelle (VM) et leurs homologues basés sur des périphériques FPGA. Le DMA fonctionne sur des files d’attente basées sur des descripteurs et configurées par un pilote Linux pour transférer des données entre le FPGA et l’hôte. Lorsque les files d’attente sont remplies, la logique de contrôle lit les descripteurs de file d’attente et les exécute. Une fois exécuté, le DMA fournira une interruption pour noter l’achèvement de la transaction.
Lors de l’élaboration de solutions au niveau du système PCI Express, l’IP DMA multicanal avec l’IP matérielle PCIe prend à la fois en charge les topologies de port racine (RP) et de point de terminaison (EP). Ce type de configuration, de compatibilité et de flexibilité permet une intégration transparente dans diverses plates-formes allant de l’embarqué à l’entreprise.
| IP | Inclus dans le logiciel de conception Prime Quartus® | Codes de commande |
|---|---|---|
Agilex™ 5 FPGA – Intel FPGA IP DMA multicanal AXI pour PCI Express (Interface AXI-Stream) |
Non | IP-PCIEMCDMA-AXI-AG5 |
Agilex™ 7 FPGA – Intel FPGA IP DMA multicanal AXI pour PCI Express (Interface AXI-Stream) (disponible avec R-Tile) |
Non | IP-PCIEMCDMA-AXI |
| Agilex™ 7 et Stratix® 10 FPGAs – Intel FPGA IP DMA multicanal pour PCI Express (interfaces AVMM / AVST) (disponible avec H-Tile (Stratix® 10), P-Tile, F-Tile et R-Tile) | Non | IP-PCIEMCDMA |
Contactez votre représentant commercial local pour plus d’informations concernant le guide de l’utilisateur Agilex™ 5 FPGA – AXI Multichannel DMA IP et le guide de l’utilisateur de l’exemple de conception
- Options d’interface de l’application : AXI-Stream, Avalon Memory-Mapped, ou Avalon Streaming
- Capacités DMA FPGA Agilex™ 7
- Capacités DMA FPGA Agilex™ 5
- Configurabilité du port racine ou du point de terminaison
- Interruption MSI-X intégrée pour les opérations DMA
- Prise en charge des tags 10 bits au niveau DMA pour assurer un suivi et une gestion corrects des transactions
- Prend en charge la réorganisation de l’achèvement et le délai d’achèvement
- Conçu pour éviter le blocage de la tête de ligne sur tous les canaux
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